共6页第1页 年月日 西安邮电学院课程考试试题(B卷) 考试用 （2010一一2011学年度第1学期) 课程名称：数字电路与逻辑设计 试卷类型：(A、B、C) 考试专业、年级：电子0801-0808、通工0801-0816、科技0801-0804 光电0801-0804、光信息0801-0803 题号 三 四 五 六 七 八 九总分 得分 阅卷人 填空题（每空2分，共20分） 1.余3BCD码(O1110101)◆3D4用十六进制码表示为 2.函数F=A,B+BC的最小项表达式为F-∑( 毁 F的与非与非表达式为 (允许反变量输入). F的反演式为 F的对偶式为 3.某T与非门的标准输入高电平为3.6伏，标准输入低电平为0.3伏，关门电平 'r=1.0V,开门电平Vax=2.0V,则低电平噪声容限V=_ 高电平噪声容限'a= 4.要构成容量为1K×4bit的RAM,需要片容量为256×8bit的RAM. 5.一个初始状态为0101的模值为13的四位二进制同步递加计数器经过19个CP脉冲后， 其状态为 一组合逻辑电路的输入、输出波形如下图所示，A、B为输入信号，F为输出信号， 则输出信号F与输入信号A、B的逻辑关系为F=」 蹬 说明：1、除填空愿、图解及特要求外一般不留答题空间
共 6 页 第 1 页 说 明 ：1、 除 填空题、图 解及特 要求外 一般 不留答 题空 间。 - 装- 订- 线- - - - 装- 订- 线- - - 西安邮电学院课程考试试题（B 卷） （ 2010 —— 2011 学年度第 1 学期） 课程名称：数字电路与逻辑设计 试卷类型：（A、B、C） 考试专业、年级：电子 0801-0808、通工 0801-0816、科技 0801-0804 光电 0801-0804、光信息 0801-0803 题号 一 二 三 四 五 六 七 八 九 总分 得分 阅卷人 一．填空题 （每空 2 分，共 20 分） 1．余 3BCD 码 (01110101) 余 3BCD 码 用十六进制码表示为 。 2．函数 F A B BC = + 的最小项表达式为 = ( ) m F ， F 的与非与非表达式为 (允许反变量输入)， F 的反演式为 ，F 的对偶式为 ， 3．某 TTL 与非门的标准输入高电平为 3.6 伏，标准输入低电平为 0.3 伏，关门电平 1.0 V V OFF = ,开门电平 2.0 V V ON = , 则低电平噪声容限 VNL = , 高电平噪声容限 VNH = 。 4. 要构成容量为 1K×4bit 的 RAM，需要 片容量为 256×8bit 的 RAM。 5. 一个初始状态为 0101 的模值为 13 的四位二进制同步递加计数器经过 19 个 CP 脉冲后， 其状态为 。 6. 一组合逻辑电路的输入、输出波形如下图所示，A、B 为输入信号，F 为输出信号， 则输出信号 F 与输入信号 A、B 的逻辑关系为 F＝ A B F 专业班 级 姓名 学号 年 月 日 考试用
总印1600份 (附答趣纸1页) 二.选择题：(30分) 注意： 1.每道题的正确答案只有一个，请将正确答案填入第二题答题栏中，以横线划过答 题栏所选的答案，例如： 2.题中涉及到的中规模器件的功能表，附在试卷纸的最后一页。 第二题答题栏 1 3 4 56 789 A A AAAAA B 0 D E 1,TTL与非门电略如右图所示，输出F= AA BB C.A+B DAB E.0 12K0 2.下图所示电路中，Y1= A.F=0 B.F=ABC+DE C.F=ABC.DE D.F=A+B+C.D+E E.以上答案都不对 A 100K 2。装订试卷，考生答卷时不得拆开或在框外留写标记，否则按零分计
总印 1600 份 （附答题纸 1 页） 二．选择题：（30 分） 注意： 1.每道题的正确答案只有一个，请将正确答案填入第二题答题栏中，以横线划过答 题栏所选的答案，例如： 2.题中涉及到的中规模器件的功能表，附在试卷纸的最后一页。 第二题答题栏 1．TTL 与非门电路如右图所示，输出 F＝ A．A B. B C．A+B D. AB E. 0 2．下图所示电路中，Y1 ＝ A. F=0 B. F= ABC DE + C. F= ABC DE D. F= A B C D E + + + E. 以上答案都不对 题 号 1 2 3 4 5 6 7 8 9 10 选 择 答 案 A A A A A A A A A A B B B B B B B B B B C C C C C C C C C C D D D D D D D D D D E E E E E E E E E E 2． 装 订 试卷 ， 考生 答 卷时 不 得拆 开 或在 框 外留 写 标记 ，否 则 按零分计
共6页第2页 3.以下各单元电路中， 可以产生时序电路所需要的占空比近似为为50%的时钟脉冲信号。 A四位并行全加器 B.单稳态触发器 C,多谐振荡器 D.数值比较器 E.JK触发器 4.某电路的VHDL语言描述 ENTITY test is 如右所示，此test实现的逻辑功能为： PORT (a,b:IN STD_LOGIC A.一位二进制数半加器 so,co:OUT STD_LOGIC方 雾 B.D触发器 END ENTITY test: C.二输入与非门 ARCHITECTURE one OFtest IS D.二选一数据选择器 BEGIN E.2-4线译码器 so<=a xor b; co<=a and b; END ARCHITECTURE one; 毁 5.电路如下，芯片4008为四位二进制全加器，管脚A3A2A1A0、B3B2B1B0为被加数、加数， 管脚S3S2S1S0为本位和，管脚CN为低位向本位的进位，外接信号4，管脚C0UT为本位向 高位的进位 电路如图所示， 分析电路 下列说法正确的是 .Vdd M 4008 A.M=0,S3S2S1S0为1101，C0UT为1 B.M=0,S3S2S1S0为1101，C0UT为0 C.M=1,S3s2S1S0为0101，C0UT为1 说明：1、除填空愿、图解及特要求外一般不留答愿空间
共 6 页 第 2 页 说 明 ：1、 除 填空题 、图 解及特 要求外 一般 不留答 题空 间。 - 装- 订- 线- - - - 装- 订- 线- - - 3.以下各单元电路中， 可以产生时序电路所需要的占空比近似为为 50%的时钟脉冲信号。 A. 四位并行全加器 B.单稳态触发器 C. 多谐振荡器 D.数值比较器 E. JK 触发器 4. 某电路的 VHDL 语言描述 如右所示，此 test 实现的逻辑功能为： A. 一位二进制数半加器 B. D 触发器 C. 二输入与非门 D. 二选一数据选择器 E. 2－4 线译码器 5. 电路如下，芯片 4008 为四位二进制全加器，管脚 A3 A2 A1 A0、B3 B2 B1 B0 为被加数、加数， 管脚 S3 S2 S1 S0 为本位和，管脚 CIN 为低位向本位的进位，外接信号 M, 管脚 COUT 为本位向 高位的进位，电路如图所示，分析电路，下列说法正确的是： A. M=0，S3 S2 S1 S0 为 1101，COUT 为 1 B. M=0 ，S3 S2 S1 S0 为 1101，COUT 为 0 C. M=1 ，S3 S2 S1 S0 为 0101，COUT 为 1 Ｄ. M=1 ，S3 S2 S1 S0 为 0101，COUT 为 0 Ｅ. 以上均不对 专业班 级 姓名 学号 ENTITY test is PORT (a,b: IN STD_LOGIC ; so,co: OUT STD_LOGIC ); END ENTITY test; ARCHITECTURE one OFtest IS BEGIN so<=a xor b; co<=a and b; END ARCHITECTURE one;
总印1600 (附答题纸1页) 6.下列电略的逻辑功能为： A模16计数器 B.可以自启动的扭环形计数器 C.可以自启动的环形计数器 不可自启动的环形计数器 不可自启动的扭环形计数器 因国国国 CP 7.74153是4选1数据选择器，用74153实现函数：FA,B,C)-∑m(0,3,5,6,7), 正确的电路是： A 74153 74153 D 74153 74153 C. E,以上电路均不对 2.装订试卷，考生答卷时不得拆开或在框外留写标记，否则安零分计
总印 1600 份 （附答题纸 1 页） 6. 下列电路的逻辑功能为： A. 模 16 计数器 B. 可以自启动的扭环形计数器 C. 可以自启动的环形计数器 D. 不可自启动的环形计数器 E. 不可自启动的扭环形计数器 7. 74153 是 4 选 1 数据选择器，用 74153 实现函数：F(A,B,C)=∑m(0,3,5, 6,7), 正确的电路是： E，以上电路均不对 2． 装 订 试卷 ， 考生 答 卷时 不 得拆 开 或在 框 外留 写 标记 ，否 则 安零 分 计
共6页第3页 在数字电路中，以下说法正确的是： A.N个逻辑变量共有2N个最小项。 B.在主从K触发器、边沿D触发器、同步RS触发器中，输入项有约束条件的触发器是 主从K触发器」 C.逻辑电路的电平噪声容限愈大，其抗噪声能力越强。 D.F=AB+C+DE,则F的反函数F=瓜+B)CD E.以上答案都不对 9.用ROM实现的逻辑电路如下图所示，则输出端Y1、Y2的表达式为： A Y=ABC +ABC+ABC+ABC Y,BC+CA B. Y=ABC+ABC+ABC+ABC Y,AB+CA C. Y=ABC+ABC+ABC+ABC Y=BC+BA 毁 D. Y=ABC+ABC+ABC+ABC Y=BC+CA E. 以上答案都不对 b B C。 列 存或 Y 说明：1、除填空题、图解及特要求外一般不留答愿空间
共 6 页 第 3 页 说 明 ： 1、 除 填空题 、图 解及特 要求外 一般 不留答 题空 间。 - 装- 订- 线- - - - 装- 订- 线- - - 8．在数字电路中，以下说法正确的是： A. N 个逻辑变量共有 2N 个最小项。 B. 在主从 JK 触发器、边沿 D 触发器、同步 RS 触发器中，输入项有约束条件的触发器是 主从 JK 触发器。 C. 逻辑电路的电平噪声容限愈大，其抗噪声能力越强。 D. F = AB C D E + + ，则 F 的反函数 F = (A + B) •C• D•E E. 以上答案都不对 9. 用 ROM 实现的逻辑电路如下图所示，则输出端 Y1、Y2 的表达式为： A. Y1 = ABC + ABC + ABC + ABC Y2 = BC + CA B. Y1 = ABC + ABC + ABC + ABC Y2 = AB +CA C. Y1 = ABC + ABC + ABC + ABC Y2 = BC + BA D. Y1 = A BC + ABC + AB C + ABC Y2 = BC +CA E. 以上答案都不对 专业班 级 姓名 学号