第2章TMS320c54X数字信号处理器硬件结构 21TMS320c54x的特点和硬件组成框图 22TMS320c54x的总线结构 2.3TMS320c54Xx的存储器分配 24中央处理单元(cPU 25TMS320c54X片内外设简介 2.6硬件复位操作 27TMS320Vc5402引脚及说明
第2章 TMS320C54x数字信号处理器硬件结构 ◼ 2.1 TMS320C54x的特点和硬件组成框图 ◼ 2.2 TMS320C54x的总线结构 ◼ 2.3 TMS320C54x的存储器分配 ◼ 2.4 中央处理单元（CPU） ◼ 2.5 TMS320C54x片内外设简介 ◼ 2.6 硬件复位操作 ◼ 2.7 TMS320VC5402引脚及说明
2.1TMS320c54X的特点和硬件组成框图 TMS320c54x的主要特性如下所示: CPU 先进的多总线结构 40位算术逻辑运算单元(ALU)。 17位×17位并行乘法器与40位专用加法器相连。 比较、选择、存储单元(cSSU)。 指数编码器可以在单个周期内计算40位累加器中数值的 指数。 双地址生成器包括8个辅助寄存器和两个辅助寄存器算术 运算单元(ARAU)。 返回首页
2.1 TMS320C54x的特点和硬件组成框图 ◼ TMS320C54x的主要特性如下所示： CPU ◼ 先进的多总线结构。 ◼ 40位算术逻辑运算单元（ALU）。 ◼ 17位×17位并行乘法器与40位专用加法器相连。 ◼ 比较、选择、存储单元（CSSU）。 ◼ 指数编码器可以在单个周期内计算40位累加器中数值的 指数。 ◼ 双地址生成器包括8个辅助寄存器和两个辅助寄存器算术 运算单元（ARAU）。 返回首页
存储器 64K字程序存储器、64K字数据存储器以及64K 字o空间。在C548、c549、c5402、c5410和 c5420中程序存储器可以扩展
存储器 ◼ 64 K字程序存储器、64 K字数据存储器以及64 K 字I/O空间。在C548、C549、C5402、C5410和 C5420中程序存储器可以扩展
指令系统 单指令重复和块指令重复操作。 块存储器传送指令。 32位长操作数指令。 同时读入两个或3个操作数的指令。 并行存储和并行加载的算术指令。 条件存储指令 从中断快速返回指令
指令系统 ◼ 单指令重复和块指令重复操作。 ◼ 块存储器传送指令。 ◼ 32位长操作数指令。 ◼ 同时读入两个或3个操作数的指令。 ◼ 并行存储和并行加载的算术指令。 ◼ 条件存储指令。 ◼ 从中断快速返回指令
在片外围电路(如图21所示) 软件可编程等待状态发生器。 可编程分区转换逻辑电路。 带有内部振荡器。 外部总线关断控制,以断开外部的数据总线、地 址总线和控制信号。 数据总线具有总线保持器特性。 可编程定时器。并行主机接口(HPI)
在片外围电路（如图2-1所示） ◼ 软件可编程等待状态发生器。 ◼ 可编程分区转换逻辑电路。 ◼ 带有内部振荡器。 ◼ 外部总线关断控制，以断开外部的数据总线、地 址总线和控制信号。 ◼ 数据总线具有总线保持器特性。 ◼ 可编程定时器。并行主机接口（HPl）