MIPS-X处理器的意外事件处理机制 ·处理器状态字PSW( Processor status Word)包括两组信息位 PSWcurrent和 PSWother PSWcurrent:机器的当前状态 ISOther:当意外事件出现后, PSWcurrent→ PSWother Jpcrs( Jump pC and restore state)指令: PSWother→ PSWcurrent 北京大学计算机科学技术系 计算机系统结构教研室
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MIPS-X处理器的意外事件处理机制(续→) PC链 转移延迟为2 时阋时钟周蚴|D/ RF EX MEM WB 10 bra 100 M H Reg La DM Reg 指14add IM HE Reg DM H Reg MHRg:用DMRg 次 18 sub 序 100 ori IM R leg DM leg 104 xor Mem g Reg I用MemR 中断后恢复状态,必须重启三条指令 北京大学计算机科学技术系 计算机系统结构教研室
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