处理器性能 CP °计算机的性能决定于: 指令总数 ·时钟周期时间 指令总数 周期时间 每条指令的时钟周期数目 处理器设计(数据通路和控制)将决定 ·时钟周期时间 每条指令的时钟周期数目 °单周期处理器: ·优点:每条指令一个时钟周期 缺点:时钟周期时间太长 北京大学计算机科学技术系 计算机系统结构教研室
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如何设计处理器:循序渐进 1分析指令系统=>数据通路需求 通过寄存器传输描述每条指令的意图 针对lSA寄存器,数据通路必须具备必要的存储元件 可能需要多个 数据通路必须支持每种寄存器传输 2.选择一组数据通路部件,建立时钟同步方法 3根据需求,组装数据通路 4.分析每条指令的实现,以确定如何设置影响寄存器传 输的控制点 5.装配控制逻辑 北京大学计算机科学技术系 计算机系统结构教研室
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MIPS指令格式 °所有的MPS指令都是32位长。具有如下三种格式 26 ·R型 op d shamt funct 6 bits 5 bits 5 bits s bits 5 bits 6 bits 31 26 21 型 rt immediate 6 bits s bits 5 bits 16 bits J型 26 0 target address 6 bits 26 bits °不同的场位为: op:指令的操作 rs,rt,rd:源和目的寄存器描述符 · shamt:移位量 · funct:选择op场位指定的不同操作 · address/ immediate:地址偏移量或者立即数数值 target address:跳转指令的目标地址 北京大学计算机科学技术系 计算机系统结构教研室
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本讲涉及的MIPS指令系统子集 °加法和减法 rt rd shamt funct · add rd,rs,rt 6 bits 5 bits 5 bits 5 bits 5 bits 6 bits sub rd rs rt 16 °或立即数: rs rt immediate ori rt, rs, imm16 6 bits 5 bits 5 bits 16 bits °装入和存储 lwrt. rs, imm16 swt rs, imm16 转移 beq rs, rt, imm16 26 °跳转 target address 6 bits 26 bits 北京大学计算机科学技术系 计算机系统结构教研室
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逻辑寄存器传输 °寄存器传输语言(RTL)描述每条指令的意图 °所有的指令都以取指开始 op rs rt rd shamt funct=MEMIPC I op rs rt Imm16 MEMI PC I inst Register Transfers ADDu Rrd∈Rrs+Rrt; PC←PC+4 SUBU Rrd∈R|rs-Rrt; PC←PC+4 ORi R[rt∈=Rrs」 U zero ext((mm16); PC←PC+4 LOAD Rrt∈MEM[Rrs+ sign ext((mm16)};PC∈PC+4 STORE MEMIRrs」+ sign ext(lmm16)]∈=R[rt;PC∈PC+4 BEQ if(rrs]=rrt)then PC ePC sign ext(Imm16)100 else po←PC+4 北京大学计算机科学技术系 计算机系统结构教研室
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