存储器访问时疽 °物理大小>小存储器速度快(大存储器速度慢) Storage Array selected word line storage cel address bit line address decoder sense amps 问题:寄存器堆vs.存储器 °>使用层次存储系统 Processor<l Caches Cache E memory cycle cycles 20-50 cycles 北京大学计算机科学技术系 计算机系统结构教研室
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减少时钟周期时间 °切分组合相关图,插入寄存器锁存器 °在两个较短的周期内(而非一个较慢的周期内)完成上述相同工作 存储单元 存储单元 无环 无环 组合逻辑(A) 组合逻辑 存储单元 无环 组合逻辑(B) 存储单元 存储单元 北京大学计算机科学技术系 计算机系统结构教研室
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对时钟周期时间的基本限制 °下一地址生成逻辑 PC E branch PC offset: PC +4 °取指逻辑 InstructionReg e Mem[Pc] °寄存器访问 A∈=R[rs Control °ALU操作 ·R←A+B Oxoz Exec E E 北京大学计算机科学技术系 计算机系统结构教研室
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